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   芯片、集成电路设计培训课程表

        培训结束后颁发工程师培训证书。

   班级规模及环境--热线:4008699035 手机:15921673576/13918613812( 微信同号)

        为了保证培训效果,增加互动环节,我们坚持小班授课,每期报名人数限3到5人。人手一机,全程实践。

   上课时间和地点

          上课地点:【上海】:同济大学(沪西)/新城金郡商务楼(11号线白银路站) 【深圳分部】:电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】:北京中山/福鑫大楼 【南京分部】:金港大厦(和燕路) 【武汉分部】:佳源大厦(高新二路) 【成都分部】:领馆区1号(中和大道) 【沈阳分部】:沈阳理工大学/六宅臻品 【郑州分部】:郑州大学/锦华大厦 【石家庄分部】:河北科技大学/瑞景大厦 【广州分部】:广粮大厦 【西安分部】:协同大厦
          本课程每期班限额5名,报满即停止报名,请提前在线或电话预约

   课时
        ◆课时:咨询在线客服
        ◆团体报名优惠措施:两人95折优惠,三人或三人以上9折优惠 。注意:在读学生凭学生证,即使一个人也优惠500元。
        
        ☆注重质量
        ☆边讲边练

        ☆合格学员免费推荐工作

        

        专注高端培训17年,曙海提供的课程得到本行业的广泛认可,学员的能力
        得到大家的认同,受到用人单位的广泛赞誉。

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   质量保障

        1、培训过程中,如有部分内容理解不透或消化不好,可免费在下期培训班中重听;
        2、课程完成后,授课老师留给学员手机和Email,保障培训效果,免费提供半年的技术支持。
        3、培训合格学员可享受免费推荐就业机会。

   课程大纲
        全部授课内容均在计算机和实验器材上实际操作。 周末班、连续班、晚班任选

芯片、集成电路设计培训课程表

 

序号

近开课时

芯片、集成电路设计系列培训班

W1

ASTRO高级培训班(Synopsys)

ASTRO高级培训班(Synopsys)

2024年3月25日......(欢迎您垂询,视教育质量为生命!)

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W2

Virtuoso Layout高级培训班(Cadence)

Virtuoso Layout高级培训班(Cadence)

2024年3月25日......(欢迎您垂询,视教育质量为生命!)

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W3

Design Compiler高级培训班(Synopsys)

Design Compiler高级培训班(Synopsys)

2024年3月25日......(欢迎您垂询,视教育质量为生命!)

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W4

Modelsim高级培训班(Mentor Graphics )

Modelsim高级培训班(Mentor Graphics )

2024年3月25日......(欢迎您垂询,视教育质量为生命!)

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W5

R/E(即IC逆向设计)技术培训

R/E(即IC逆向设计)技术培训

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W6

Cadence模拟电路前端设计培训

Cadence模拟电路前端设计培训

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W7

Cadence 混合信号应用

Cadence 混合信号应用

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W8

Calibre与Cliosoft技术培训

Calibre与Cliosoft技术培训

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W9
SpringSoft Laker模拟与混合信号版图设计培训

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W10

低功耗SOC设计培训

低功耗SOC设计培训

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W11

IC版图设计与验证培训课程

IC版图设计与验证培训课程

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W12

SoC Encounter RTL-to-GDSII物理实现

SoC Encounter RTL-to-GDSII物理实现

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W13

Synopsys Astro培训

Synopsys Astro培训

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W14
Cadence Assura DRC/LVS物理验证和寄生参数提取培训

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W15

DFT(Design For Test)ATPG&MBIST培训(MentorGraphics)

DFT(Design For Test)ATPG&MBIST培训(MentorGraphics)

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W16

AMS 方法学(Methodology Kit)培训(Cadence)

AMS Methodology Kit培训(Cadence)

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W17

Virtuoso AMS Designer &Virtuoso XL Layout Editor培训(Cadence)

Virtuoso AMS Designer &Virtuoso XL Layout Editor培训(Cadence)

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W18

Prime Time & Design Compiler培训

Prime Time & Design Compiler培训

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W19
FPGA验证平台培训(Hyperform)

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W20

Active-HDL Celoxica RC250 Riviera CoVer培训

Active-HDL Celoxica RC250 Riviera CoVer培训

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W21

Cadence Assura Verification培训

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W22

Low Power Implementation(Cadence)培训

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W23
Synopsys Verification With VCS培训

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W24
Signoff Timing Analysis with Encounter Timing System培训

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W25
Digital IC Design and Verification培训

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W26
Synopsys Nanosim培训

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W27
Magma 数字流程培训

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W28
版图验证工具ZeniHVeri培训

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W29
Synopsys IC Compiler培训

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W30
Synopsys-DFT Compiler 培训

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W31
Synopsys PrimeTime SI 培训

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W32
Cadence协同设计(Co-Design)

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W33
Formality培训班

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W34
Allegro FPGA System Planner培训

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W35
SpringSoft Novas产品线培训

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W36
MentorGraphics Modelsim验证培训

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W37
Mentor A/MS Design Verification培训

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W38
Synopsys TetraMAX EDA培训

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W39
Virtuoso Chip Assembly Router培训

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W40
MentorGraphics EDA验证培训

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W41
Cadence Incisive设计验证平台培训

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W42
Synopsys DC-T培训

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W43
Mentor DFT ATPG & MBIST培训

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W44
Synopsys SystemVerilog VMM培训

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W45
Synopsys Hsim培训

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W46
混合信号验证平台ADMS培训

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W47
Cadence模拟电路前端设计培训

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W48
九天EDA工具培训

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W49
Synopsys DesignWare Library and DesignWare AMBA VIP培训

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W50
Mentor FPGA设计培训

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W51
Synopsys Power Compile培训

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W52
Synopsys综合培训班

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W53
高级SOC版图设计(P&R)方法培训

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W54
IC版图/数字IC设计技巧高级班

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W55
Cadence NC Sim 培训

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W56
集成电路版图设计师培训班

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W57
Synopsys SystemVerilog验证培训

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W58
RTL Synthesis(Design Synthesis)培训

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W59
Design Sign-Off培训

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W60
Physical Design Implementation培训课程

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W61
DFM&TCAD培训课程

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W62
FPGA设计执行培训课程

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W63
Optical Design(CODE V and LightTools)培训课程

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W64
Incisive Comprehensive Coverage培训

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W65
Signoff Power-Grid Analysis with Encounter Power System培训

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W66
SKILLLanguageProgramming培训

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W67
Virtuoso Connectivity-Driven Layout培训

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W68
Virtuoso Layout Design Basics vIC培训

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W69
Virtuoso Space-based Router vIC培训

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W70
Virtuoso UltraSim Full-chip Simulator vMMSIM培训

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W71
Encounter Digital Implementation (Flat)培训

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W72
Functional verification培训

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W73
Silicon-package-board co-design培训

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W74
Encounter Digital Implementation (Hierarchical)培训

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W75
Encounter RTL Compiler培训班

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W76
Signoff Power-Grid Analysis with Encounter Power System培训班

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.(2014年7月11).......................................................................................
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